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中國(guó)數(shù)字地面電視標(biāo)準(zhǔn)中LDPC碼的半并行譯碼結(jié)構(gòu)設(shè)計(jì)

2009-01-01 00:00:00林競(jìng)力朱維樂(lè)陳客松

(1.電子科技大學(xué) 電子工程學(xué)院 成都 610054;2.空軍大連通信士官學(xué)校 遼寧 大連 116110)

摘 要:中國(guó)數(shù)字地面電視廣播標(biāo)準(zhǔn)采用準(zhǔn)循環(huán)低密度校驗(yàn)碼(QCLDPC)作為其信道編碼的內(nèi)碼。根據(jù)該類LDPC碼的準(zhǔn)循環(huán)特性,提出了一種基于后驗(yàn)概率的簡(jiǎn)化最小和算法及其對(duì)應(yīng)的半并行譯碼結(jié)構(gòu)。其可實(shí)現(xiàn)在同一接收機(jī)中盡量復(fù)用硬件資源并減少消耗情況下LDPC碼的多碼率譯碼。最后,使用可編程門陣列實(shí)現(xiàn)了此結(jié)構(gòu)并驗(yàn)證了其性能,實(shí)驗(yàn)表明,該方法比傳統(tǒng)的最小和算法性能略有降低,但可節(jié)約大量存儲(chǔ)器資源。

關(guān)鍵詞:中國(guó)數(shù)字地面電視廣播標(biāo)準(zhǔn);準(zhǔn)循環(huán)低密度校驗(yàn)碼;多碼率;最小和算法;半并行;現(xiàn)場(chǎng)可編程門陣列

中圖分類號(hào):TN911.22文獻(xiàn)標(biāo)志碼:A

文章編號(hào):1001-3695(2009)05-1792-04

Design of decoder for LDPC codes used in CDTTB standard

LIN Jingli1,SUN Gang2,ZHU Weile1,CHEN Kesong1

(1.School of Electronic Engineering University of Electronic Science Technology of China Chengdu 610054China;2.Petty Officer Academy of Communication of Air Force Dalian Liaoning 116110 China)

Abstract:Quasicyclic lowdensity paritycheck codes (QCLDPC) have been adopted as the inner code of channel codes in Chinese digital terrestrial television broadcasting standard (CDTTB).Based on its systematic circulant form this paper presented a simplified minsum decoding algorithm based on aposteriori probabilities and its corresponding decoder with semiparallel architecture. The decoding of LDPC codes at multiple rates can be achieved in one receiver. With fully multiplexing the hardware resources are reduced on the premises that the payload rates are met. The properties of the decoder are verified on FPGA.

Key words:CDTTB; QCLDPC; multiple rates; minsum decoding algorithm; semiparallel; FPGA

低密度校驗(yàn)(LDPC)碼[1]是Gallager提出的一類可用稀疏校驗(yàn)矩陣描述的線性分組碼。因?yàn)槠湓诘g碼條件下逼近Shannon限的能力[2],近年來(lái)受到越來(lái)越多的關(guān)注,并且,已成功地應(yīng)用于多個(gè)行業(yè)標(biāo)準(zhǔn),包括中國(guó)數(shù)字地面電視標(biāo)準(zhǔn)(CDTTB)[3]。相較編碼而言,LDPC碼譯碼有著更高的復(fù)雜度,因此,譯碼一直是LDPC碼研究的焦點(diǎn)之一。除了各種簡(jiǎn)化和近似譯碼算法的推導(dǎo)[4],人們也廣泛研究各種便于譯碼的校驗(yàn)矩陣的構(gòu)造方式。例如文獻(xiàn)[6]設(shè)計(jì)的一種聯(lián)合(3,k)結(jié)構(gòu),并為其提供了一種便于硬件實(shí)現(xiàn)的譯碼方案。

CDTTB信道編碼采用準(zhǔn)循環(huán)LDPC碼[7]作為其內(nèi)碼,這是一種結(jié)構(gòu)化LDPC碼。因?yàn)槠浣Y(jié)構(gòu)性特征,可從存儲(chǔ)的生成矩陣和校驗(yàn)矩陣部分行列信息遞推完成編譯碼,為硬件實(shí)現(xiàn)帶來(lái)極大的便利。本文根據(jù)其結(jié)構(gòu),描述了在一個(gè)接收機(jī)內(nèi)可實(shí)現(xiàn)三種碼率譯碼的譯碼器的FPGA設(shè)計(jì)方案。

1 基于后驗(yàn)概率的簡(jiǎn)化最小和算法 

BP算法[8]是LDPC碼譯碼最常用的算法之一。但因?yàn)槠漭^高的復(fù)雜度,文獻(xiàn)[5]提出了一種對(duì)該算法的垂直運(yùn)算作線性擬合的方法,將把整個(gè)區(qū)間復(fù)雜的運(yùn)算分解為幾個(gè)區(qū)間簡(jiǎn)單的線性運(yùn)算;文獻(xiàn)[4]則推導(dǎo)了和積算法的近似算法——最小和算法及其修正算法。考慮到譯碼復(fù)雜度和性能的折中,本文所描述譯碼結(jié)構(gòu)采用最小和算法。

本文以信號(hào)在二進(jìn)制移相鍵控(BPSK)調(diào)制方式下通過(guò)加性高斯白噪聲(AWGN)信道為例描述對(duì)數(shù)域的最小和算法。其中,LDPC碼的校驗(yàn)矩陣H為M×N維,發(fā)送碼元0、1分別映射為1和-1,從而接收端收到信號(hào)yn=xn+zn,0≤n<N。zn是均值為0、方差為σ2的高斯噪聲。在其他調(diào)制方式和衰落信道情況下可依此類推得到相應(yīng)算法。

1.1 最小和算法

相較BP算法,最小和算法不必估計(jì)信道噪聲方差,校驗(yàn)節(jié)點(diǎn)信息更新后傳遞給與之相連的各信息節(jié)點(diǎn)的似然率計(jì)算簡(jiǎn)便。

1.1.1 初始化

每個(gè)信息節(jié)點(diǎn)vn的初始對(duì)數(shù)似然率(LLR)(0≤n<N):

Ln=yn(1)

1.1.2 水平運(yùn)算

這是校驗(yàn)矩陣每行的運(yùn)算,即二分圖上每個(gè)校驗(yàn)節(jié)點(diǎn)的運(yùn)算。在下文中,將不加區(qū)別地使用校驗(yàn)矩陣的行和校驗(yàn)節(jié)點(diǎn)。

Lkmn=n′∈B(m)\sign(Lk-1n′m

minn′∈B(m)\|Lk-1n′m|(2)

其中:n′∈B(m)\表示除了校驗(yàn)節(jié)點(diǎn)cm與信息節(jié)點(diǎn)vn相連的邊外所有連接到cm的邊的集合,0≤m<M;k是迭代次數(shù);符號(hào)sign(#8226;)表示取符號(hào)函數(shù);min(#8226;)是求最小值函數(shù)。

1.1.3 垂直運(yùn)算

這是校驗(yàn)矩陣每列的運(yùn)算,即二分圖上每個(gè)信息節(jié)點(diǎn)的運(yùn)算。在下文中,將不加區(qū)別地使用校驗(yàn)矩陣的列和信息節(jié)點(diǎn)。

Lknm=L0n+m′∈A(n)\\mLkm′n(3)

其中:m′∈A(n)\\m表示除了信息節(jié)點(diǎn)vn與校驗(yàn)節(jié)點(diǎn)cm相連的邊外所有連接到vn的邊的集合,0≤n<N。

1.1.4 嘗試譯碼判決

Lkn=L0n+A(n)Lkmn(4)

qn=sign(Lkn)(5)

定義Q=(q0,q1,…,qn-1),若HQ′=0,則迭代譯碼結(jié)束;否則如果沒有達(dá)到最大迭代次數(shù),則返回水平運(yùn)算繼續(xù)迭代譯碼。

1.2 基于后驗(yàn)概率的簡(jiǎn)化最小和算法 

在LDPC碼譯碼運(yùn)算時(shí),無(wú)論水平運(yùn)算還是垂直運(yùn)算,節(jié)點(diǎn)nd傳遞給相鄰節(jié)點(diǎn)(neighboring node)的信息均不包括該相鄰節(jié)點(diǎn)傳遞給nd的信息。因此,節(jié)點(diǎn)nd傳遞給各相鄰節(jié)點(diǎn)似然率各不相同。原則上,校驗(yàn)矩陣中“1”元素的個(gè)數(shù)就是在水平運(yùn)算和垂直運(yùn)算時(shí)分別需要的運(yùn)算結(jié)果存儲(chǔ)器的個(gè)數(shù)。LDPC碼雖然是稀疏矩陣,但在碼長(zhǎng)較長(zhǎng)時(shí)(如本文所論LDPC碼長(zhǎng)度7 493 bit),分配如此之多的存儲(chǔ)器,對(duì)硬件設(shè)計(jì)而言,基本不可接受。

文獻(xiàn)[9]提出一種硬件結(jié)構(gòu),其對(duì)于校驗(yàn)節(jié)點(diǎn)更新結(jié)果,存儲(chǔ)式(4)的Lkn。在進(jìn)行下次水平運(yùn)算時(shí),信息節(jié)點(diǎn)vn傳遞給與之相連的各校驗(yàn)節(jié)點(diǎn)的LLR分別為Lkn與上次垂直運(yùn)算時(shí)這些校驗(yàn)節(jié)點(diǎn)傳遞給該信息節(jié)點(diǎn)LLR之差。垂直運(yùn)算結(jié)果存儲(chǔ)量由原來(lái)的校驗(yàn)矩陣中“1”元素的個(gè)數(shù)減少為碼字長(zhǎng)度數(shù)目。此方法極大地減少了垂直運(yùn)算結(jié)果存儲(chǔ)量,但水平運(yùn)算結(jié)果存儲(chǔ)量仍然維持不變。

在最小和算法中,對(duì)于校驗(yàn)節(jié)點(diǎn)cm,其最多輸出兩個(gè)不同的LLR測(cè)度: 

OUTcm,0=minn′∈B(m)|Lk-1n′m|(6)

OUTcm,1= sub minn′∈B(m)|Lk-1n′m|(7)

其中:符號(hào)sub min(#8226;)表示取次最小值函數(shù)。

由最小和算法推導(dǎo)[4]可知,對(duì)同一待譯碼碼字分別使用BP算法和最小和算法進(jìn)行譯碼,設(shè)校驗(yàn)節(jié)點(diǎn)cm傳遞給信息節(jié)點(diǎn)vn的LLR分別為LBPmn和LMSmn,則一定有

|LBPmn|<|LMSmn|(8)

這也是歸一化最小和算法和偏移最小和算法的理論基礎(chǔ)。

因此,在本設(shè)計(jì)中,簡(jiǎn)化水平運(yùn)算為

Lkmn=n′∈B(m)/nsign (Lk-1n′m)minn′∈B(m)|Lk-1n′m|(9)

即水平運(yùn)算時(shí),各校驗(yàn)節(jié)點(diǎn)只輸出一個(gè)LLR測(cè)度。

同樣地,在文獻(xiàn)[9]中,提出了一種基于后驗(yàn)概率(APP)的最小和算法。其簡(jiǎn)化垂直運(yùn)算為

Lknm=L0n+m′∈A(n)Lkm′n

(10)

即在下次迭代的水平運(yùn)算時(shí),各信息節(jié)點(diǎn)傳遞給與之相連的校驗(yàn)節(jié)點(diǎn)的信息都相同。

由上述算法描述可見,基于APP的簡(jiǎn)化最小和算法使存儲(chǔ)容量需求和計(jì)算量都得到極大的降低。使水平運(yùn)算和垂直運(yùn)算結(jié)果的存儲(chǔ)量由原來(lái)的校驗(yàn)矩陣“1”元素的個(gè)數(shù)分別降低為校驗(yàn)矩陣行和列的個(gè)數(shù)。但是,此方法破壞了各節(jié)點(diǎn)消息的獨(dú)立性,不可避免地帶來(lái)性能的下降。

2 譯碼器結(jié)構(gòu)設(shè)計(jì)

2.1 CDTTB三種碼率的校驗(yàn)矩陣

CDTTB所用LDPC碼為QCLDPC碼,其校驗(yàn)矩陣形式:

H=A0,0A0,1…A0,t-1

A1,0A1,1…A1,t-1



Ac-1,0Ac-1,1…Ac-1,t-1(11)

其中:分塊矩陣Ai j是行重(列重)為1的b×b階循環(huán)矩陣(0≤i<c,0≤j<t),三種碼率LDPC碼均有b=127。

CDTTB三種碼率LDPC碼碼長(zhǎng)均為7 493 bit,其次數(shù)分布對(duì)和非零分塊矩陣個(gè)數(shù)分別如表1所示。

表1 CDTTB中LDPC碼校驗(yàn)矩陣特征表

碼率λ(x)ρ(x)非零分塊矩陣個(gè)數(shù)

0.493/275x2+72/275x3+2/5x107/55x6+48/55x7275

0.681/296x2+9/37x3+63/296x6+10/37x159/74x11+65/74x12296

0.86/49x2+74/147x3+55/147x1013/49x25+36/49x26294

因?yàn)镃DTTB三種碼率LDPC碼碼長(zhǎng)相同,分塊矩陣維數(shù)相同,并且,由表1可知,這三種碼率LDPC碼校驗(yàn)矩陣中“1”元素的個(gè)數(shù)相差不大。所以可以設(shè)計(jì)一個(gè)結(jié)構(gòu),盡可能發(fā)復(fù)用硬件資源以完成這三種碼率LDPC碼譯碼。

2.2 三種譯碼方案

由上述最小和算法流程描述可知,本設(shè)計(jì)中譯碼器基本可劃分為水平運(yùn)算和垂直運(yùn)算兩大部分。分別定義完成這兩類運(yùn)算的運(yùn)算單元為信息節(jié)點(diǎn)運(yùn)算單元(VNU)和校驗(yàn)節(jié)點(diǎn)運(yùn)算單元(CNU)。因此,若某行行重為wr,則wr個(gè)VNU可完成該行的水平運(yùn)算;若某列列重為wc,則wc個(gè)CNU可完成該列的垂直運(yùn)算。根據(jù)VNU和CNU的復(fù)用程度,有下列三種譯碼方案以供選擇。

2.2.1 串行方案

對(duì)于M×N維的校驗(yàn)矩陣H,其各行行重為wri(0<wri<N,0≤i<M),各列列重為wcj(0<wcj<M,0≤j<N),則使用max0≤i<M wri個(gè)VNU可完成一個(gè)校驗(yàn)節(jié)點(diǎn)的水平運(yùn)算(符號(hào)max(#8226;)表示取最大值),重復(fù)此操作直到所有校驗(yàn)節(jié)點(diǎn)運(yùn)算完畢;然后,再使用max0≤j<N wcj個(gè)CNU可完成一個(gè)信息節(jié)點(diǎn)的垂直運(yùn)算,重復(fù)同樣操作直到所有信息節(jié)點(diǎn)運(yùn)算完畢。此時(shí),即可完成一次迭代。

2.2.2 并行方案

對(duì)于校驗(yàn)矩陣H,使用0≤i<Mwri個(gè)VNU可一次性同時(shí)完成所有校驗(yàn)節(jié)點(diǎn)的水平運(yùn)算,再使用0≤j<Nwcj個(gè)CNU可一次性同時(shí)完成所有信息節(jié)點(diǎn)的垂直運(yùn)算。此時(shí),即已完成一次迭代。

2.2.3 半并行方案

式(11)中分塊矩陣Ai j第一行和第一列分別稱為行生成器和列生成器。根據(jù)Ai j的維數(shù),可設(shè)置復(fù)用系數(shù)b,根據(jù)H各分塊矩陣的行生成器生成地址,載入相應(yīng)的Lknm,使用0≤i<cwrb×i個(gè)VNU可一次性同時(shí)完成第0,b,2b,…,(c-1)b共c個(gè)校驗(yàn)節(jié)點(diǎn)的水平運(yùn)算,各行生成器分別循環(huán)右移更新地址載入新的Lknm,使用這些VNU可完成第1,b+1,2b+1,…,(c-1)b+1的第二批c個(gè)校驗(yàn)節(jié)點(diǎn)的水平運(yùn)算。如此循環(huán)操作b次即可完成水平運(yùn)算。在垂直運(yùn)算時(shí),根據(jù)H各分塊矩陣的列生成器生成地址,載入相應(yīng)的Lkmn,使用0≤j<twcb×j個(gè)CNU可一次性同時(shí)完成第0,b,2b,…,(t-1)b共t個(gè)校驗(yàn)節(jié)點(diǎn)的垂直運(yùn)算,各列生成器分別循環(huán)下移更新地址載入新的Lkmn,使用這些CNU可完成第1,b+1,2b+1,…,(t-1)b+1的第二批t個(gè)校驗(yàn)節(jié)點(diǎn)的垂直運(yùn)算。如此循環(huán)操作b次即可完成一次迭代。

2.2.4 三種譯碼方案比較 

根據(jù)上述三種譯碼方案描述,列出其消耗VNU/CNU和完成一次迭代運(yùn)算時(shí)鐘個(gè)數(shù)(不包括行/列生成器裝載時(shí)間)比較如表2所示。

表2 三種譯碼方案比較

譯碼方案VNU個(gè)數(shù)(NVNU)CNU個(gè)數(shù)(NCNU)時(shí)鐘個(gè)數(shù)(NCLK)

串行方案max0≤i<Mwri

max0≤j<NwcjM+N

并行方案0≤i<Mwri

0≤j<Nwcj2

半并行方案0≤i<cwrb×i

0≤j<twcb×j2b

由表2可知,三種譯碼方案中,(NVNU+NCNU)×NCLK趨近一個(gè)常數(shù),因此,本設(shè)計(jì)選擇了資源消耗和時(shí)鐘消耗都折中的半并行方案。

2.3 半并行譯碼方案 

根據(jù)上節(jié)描述,半并行譯碼方案應(yīng)包括校驗(yàn)節(jié)點(diǎn)單元(CNU)、信息節(jié)點(diǎn)單元(VNU)、校驗(yàn)節(jié)點(diǎn)更新所需比較器、信息節(jié)點(diǎn)更新所需加法器、信息節(jié)點(diǎn)更新結(jié)果存儲(chǔ)器OUTv、校驗(yàn)節(jié)點(diǎn)更新結(jié)果存儲(chǔ)器OUTc、譯碼器初始信息存儲(chǔ)器INIT、譯碼結(jié)果(Q)存儲(chǔ)器以及完成這些運(yùn)算和存儲(chǔ)的控制器;另外,還需要校驗(yàn)矩陣地址存儲(chǔ)器以存儲(chǔ)用于譯碼的校驗(yàn)矩陣。考慮到CDTTB三種碼率LDPC碼中校驗(yàn)矩陣各行/列生成器“1”元素個(gè)數(shù)最多為296(0.6碼率),因此,構(gòu)建此譯碼器整體結(jié)構(gòu)如圖1所示。

2.3.1 INIT、OUTc和OUTv存儲(chǔ)器

INIT存儲(chǔ)器存儲(chǔ)譯碼器初始信息L0n,其包括A、B兩部分,每部分存儲(chǔ)深度為碼長(zhǎng)長(zhǎng)度(7 493)。其設(shè)置成乒乓工作模式,在INITA用于譯碼時(shí),INITB用于存儲(chǔ)下一個(gè)待譯碼碼字,反之亦然。

OUTv存儲(chǔ)器存儲(chǔ)譯碼器垂直運(yùn)算結(jié)果Lknm,也需要存儲(chǔ)深度7 493。

OUTc存儲(chǔ)器各存儲(chǔ)單元內(nèi)容為

Lkmn=n∈B(m)sign(Lk-1n′m)minn∈B(m)|Lk-1n′m|(12)

即其測(cè)度為與各校驗(yàn)節(jié)點(diǎn)相連的所有信息節(jié)點(diǎn)的測(cè)度最小值,符號(hào)為這些信息節(jié)點(diǎn)符號(hào)的乘積。故其與Lkmn可能符號(hào)不同,但測(cè)度相同。因三種碼率LDPC碼校驗(yàn)矩陣最大行個(gè)數(shù)為4 445(0.4碼率),OUTc存儲(chǔ)器需要分配存儲(chǔ)深度4 445。

2.3.2 校驗(yàn)矩陣存儲(chǔ)器

校驗(yàn)矩陣作為不同LDPC碼的根本標(biāo)志和譯碼基礎(chǔ),需要事先存儲(chǔ)于校驗(yàn)矩陣存儲(chǔ)器中。CDTTB三種碼率LDPC碼共有非零分塊矩陣865個(gè)。在本設(shè)計(jì)中,分配深度為1 024的兩個(gè)LPM_ROM,分別按行順序和列順序依次存儲(chǔ)三種LDPC碼各非零分塊矩陣行/列生成器所在位置。在系統(tǒng)復(fù)位后分別載入地址發(fā)生器以產(chǎn)生讀寫INIT、OUTc和存儲(chǔ)器的地址。

2.3.3 信息節(jié)點(diǎn)單元VNU與校驗(yàn)節(jié)點(diǎn)單元CNU

VNU存儲(chǔ)用于校驗(yàn)節(jié)點(diǎn)更新的各信息節(jié)點(diǎn)的LLR。因?yàn)樾r?yàn)節(jié)點(diǎn)cm更新運(yùn)算是求取各與之相連的信息節(jié)點(diǎn)LLR測(cè)度的最小值。所以,在VNU前設(shè)置補(bǔ)碼轉(zhuǎn)換原碼結(jié)構(gòu)——CT轉(zhuǎn)換器。

CNU存儲(chǔ)用于信息節(jié)點(diǎn)更新的各校驗(yàn)節(jié)點(diǎn)的LLR。

因?yàn)镃DTTB三種碼率LDPC碼校驗(yàn)矩陣非零分塊矩陣最多為296個(gè)(0.6碼率),故系統(tǒng)共有VNU和CNU各296個(gè)。

在水平運(yùn)算開始時(shí),VNU載入校驗(yàn)矩陣各分塊矩陣第一行待運(yùn)算的LLR,在運(yùn)算的同時(shí),各地址寄存器加1,并開始載入第二行的各待運(yùn)算LLR,等等。重復(fù)上述過(guò)程127次,即可完成水平運(yùn)算。

同理,在垂直運(yùn)算時(shí),CNU順序載入校驗(yàn)矩陣各分塊矩陣每列待運(yùn)算的LLR,重復(fù)運(yùn)算127次可完成垂直運(yùn)算。

2.3.4 比較器和加法器

比較器完成各校驗(yàn)節(jié)點(diǎn)信息更新。其采用兩輸入方式,即在一個(gè)時(shí)鐘只能完成兩個(gè)LLR測(cè)度的大小比較。如此,完成一個(gè)校驗(yàn)節(jié)點(diǎn)的LLR更新,根據(jù)三種碼率LDPC碼不同的行重,其需要時(shí)鐘個(gè)數(shù)如表3所示。

加法器完成各信息節(jié)點(diǎn)信息更新。根據(jù)三種碼率LDPC碼不同的列重,分別設(shè)計(jì)輸入端子個(gè)數(shù)為3、4、7、11、16的加法器。因?yàn)樗竭\(yùn)算時(shí)為了解約存儲(chǔ)空間,符號(hào)計(jì)算采取的是計(jì)算與各校驗(yàn)節(jié)點(diǎn)相連的所有信息節(jié)點(diǎn)符號(hào)乘積的方式,如式(12)所示。所以,各信息節(jié)點(diǎn)信息更新前,與之相連的各校驗(yàn)節(jié)點(diǎn)信息需要符號(hào)位與該信息節(jié)點(diǎn)的當(dāng)前符號(hào)位相乘,如圖2所示。

2.3.5 硬判決Q存儲(chǔ)器

垂直運(yùn)算結(jié)果Lknm直接進(jìn)行硬判決輸出到Q存儲(chǔ)器。仿真表明,在LDPC碼迭代譯碼成功時(shí)(HQ′=0),若繼續(xù)迭代,Lknm輸出硬判決值不變。因此,在本設(shè)計(jì)中,不判斷譯碼是否成功,而是迭代到最大迭代次數(shù)直接輸出Q存儲(chǔ)器內(nèi)容。如此,減少了每次迭代完成后的HQ′運(yùn)算。但按照最小和算法,若HQ′=0停止迭代,可在預(yù)定的剩余迭代時(shí)間內(nèi)使系統(tǒng)進(jìn)入省電狀態(tài)。因此,本運(yùn)行方式會(huì)消耗更大的功率。

2.3.6 控制器

以上各操作都通過(guò)控制器控制完成。根據(jù)輸入的不同碼率,控制器對(duì)系統(tǒng)各部分產(chǎn)生相應(yīng)的控制時(shí)鐘完成操作。

3 FPGA實(shí)現(xiàn)

根據(jù)上述方案,本設(shè)計(jì)設(shè)定最大迭代次數(shù)為20,量化范圍為[-6.0,6.0]。編寫Verilog代碼并選用Altera公司Stratix系列EP1S80F1020C5作為測(cè)試平臺(tái),結(jié)果顯示此編碼器消耗58 312個(gè)LE單元,占FPGA總邏輯單元的73%,消耗378 984 bit的存儲(chǔ)器資源,占FPGA總存儲(chǔ)器資源的5%。編碼器最高時(shí)鐘可達(dá)57.7 MHz,故數(shù)據(jù)吞吐率大約為44.3 Mbps。

由文獻(xiàn)[3]可知,三種碼率LDPC碼數(shù)據(jù)吞吐率都大約為39.93 Mbps,故本譯碼器滿足系統(tǒng)要求。

圖3為本譯碼器實(shí)際測(cè)試結(jié)果與無(wú)限精度最小和算法仿真結(jié)果的比較。由圖可見,在誤比特率10-6時(shí),本譯碼器三種碼率性能分別比最小和算法差約0.2、0.1和0.1 dB。由文獻(xiàn)[4]可知,有限位數(shù)量化的最小和算法應(yīng)略優(yōu)于其在無(wú)限精度量化時(shí)的性能,這是因?yàn)橛邢蘖炕氲牧炕秶蓪?duì)無(wú)限量化時(shí)測(cè)度過(guò)大的錯(cuò)誤LLR作出修正。

本設(shè)計(jì)采用基于APP的簡(jiǎn)化最小和算法,其造成的信息自相關(guān)降低了性能。高碼率編碼之所以性能下降較低碼率編碼少,是因?yàn)槿N碼率LDPC碼校驗(yàn)矩陣中“1”元素個(gè)數(shù)相差不大,高碼率LDPC碼有相對(duì)較多的較小環(huán),從而自相關(guān)帶來(lái)的影響相對(duì)低碼率LDPC碼小。

4 結(jié)束語(yǔ)

本文提出了CDTTB方案的三種LDPC碼復(fù)合譯碼的半并行結(jié)構(gòu),包括總體結(jié)構(gòu)設(shè)計(jì)、各運(yùn)算單元設(shè)計(jì)和控制。通過(guò)最終FPGA實(shí)現(xiàn),證明了其能保證CDTTB數(shù)據(jù)吞吐率要求,并且,消耗較少的系統(tǒng)資源。對(duì)于CDTTB標(biāo)準(zhǔn)的應(yīng)用推廣,有一定實(shí)用意義。對(duì)其他QCLDPC碼的譯碼實(shí)現(xiàn),有一定參考價(jià)值。

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