999精品在线视频,手机成人午夜在线视频,久久不卡国产精品无码,中日无码在线观看,成人av手机在线观看,日韩精品亚洲一区中文字幕,亚洲av无码人妻,四虎国产在线观看 ?

基于可編程邏輯器件的數(shù)字電路設(shè)計

2010-05-13 09:17:24劉彩虹,陳秀萍
現(xiàn)代電子技術(shù) 2009年19期

劉彩虹,陳秀萍

摘 要:可編程邏輯器件的出現(xiàn),使得傳統(tǒng)的數(shù)字系統(tǒng)設(shè)計方法發(fā)生了根本的改變,所以有必要介紹一下基于可編程邏輯器件的數(shù)字電路設(shè)計方法。以計數(shù)器的實現(xiàn)方法作為實例,介紹了采用原理圖和硬件描述語言兩種方法作為輸入,實現(xiàn)計數(shù)器的方法,并描述了編譯仿真的方法,給出了對應(yīng)的仿真結(jié)果。采用熟悉的器件為例,使基于可編程邏輯器件的數(shù)字電路設(shè)計方法更容易理解掌握。

關(guān)鍵詞:可編程器件;計數(shù)器;數(shù)字電路;VHDL

中圖分類號:TN47文獻(xiàn)標(biāo)識碼:A

文章編號:1004-373X(2009)19-189-02

Design of Digital Circuit Based on Programmable Logic Devices

LIU Caihong,CHEN Xiuping

(Northwest Minorities University,Lanzhou,730030,China)

Abstract:The traditional design method of digital systems has fundamentally changed because of the emergence of programmable logic devices,it is necessary to introduce the design of digital circuit based on the programmable logic device.The realization methods of counter as examples,described two ways to achieve counter by schematic and hardware description language as input methods.The method of compiled simulation was described,and given the simulation results.The design of digital circuit based on the programmable logic device easier to understand and grasp by the use of familiar device.

Keywords:programmable logic devices;counter;digital circuit;VHDL

0 引 言

可編程邏輯器件PLD(Programmable Logic Device)是一種數(shù)字電路,它可以由用戶來進(jìn)行編程和進(jìn)行配置,利用它可以解決不同的邏輯設(shè)計問題。PLD由基本邏輯門電路、觸發(fā)器以及內(nèi)部連接電路構(gòu)成,利用軟件和硬件(編程器)可以對其進(jìn)行編程,從而實現(xiàn)特定的邏輯功能。可編程邏輯器件自20世紀(jì)70年代初期以來經(jīng)歷了從PROM,PLA,PAL,GAL到CPLD和FPGA的發(fā)展過程,在結(jié)構(gòu)、工藝、集成度、功能、速度和靈活性方面都有很大的改進(jìn)和提高[1]。

隨著數(shù)字集成電路的不斷更新和換代,特別是可編程邏輯器件的出現(xiàn),使得傳統(tǒng)的數(shù)字系統(tǒng)設(shè)計方法發(fā)生了根本的改變[2]。可編程邏輯器件的靈活性使得硬件系統(tǒng)設(shè)計師在實驗室里用一臺計算機(jī)、一套相應(yīng)的EDA軟件和可編程邏輯芯片就可以完成數(shù)字系統(tǒng)設(shè)計與生產(chǎn)[3]。

1 Max+plus Ⅱ簡介

Max+plus Ⅱ是一種與結(jié)構(gòu)無關(guān)的全集成化設(shè)計環(huán)境,使設(shè)計者能對Altera的各種CPLD系列方便地進(jìn)行設(shè)計輸入、快速處理和器件編程。Max+plus Ⅱ開發(fā)系統(tǒng)具有強(qiáng)大的處理能力和高度的靈活性,其主要優(yōu)點:與結(jié)構(gòu)無關(guān)、多平臺、豐富的設(shè)計庫、開放的界面、全集成化、支持多種硬件描述語言(HDL)等。

數(shù)字系統(tǒng)的設(shè)計采用自頂向下、由粗到細(xì),逐步分解的設(shè)計方法,最頂層電路是指系統(tǒng)的整體要求,最下層是具體的邏輯電路的實現(xiàn)。自頂向下的設(shè)計方法將一個復(fù)雜的系統(tǒng)逐漸分解成若干功能模塊,從而進(jìn)行設(shè)計描述,并且應(yīng)用EDA 軟件平臺自動完成各功能模塊的邏輯綜合與優(yōu)化,門級電路的布局,再下載到硬件中實現(xiàn)設(shè)計[4],具體設(shè)計過程如下。

1.1 設(shè)計輸入

Max+plus Ⅱ支持多種設(shè)計輸入方式,如原理圖輸入、波形輸入、文本輸入和它們的混合輸入。

1.2 設(shè)計處理

設(shè)計輸入完后,用Max+plus Ⅱ的編譯器編譯、查錯、修改直到設(shè)計輸入正確,同時將對輸入文件進(jìn)行邏輯簡化、優(yōu)化,最后生成一個編程文件,這是設(shè)計的核心環(huán)節(jié)。

1.3 設(shè)計檢查

Max+plus Ⅱ為設(shè)計者提供完善的檢查方法設(shè)計仿真和定時分析,其目的是檢驗電路的邏輯功能是否正確,同時測試目標(biāo)器件在最差情況下的時延,這一查錯過程對于檢驗組合邏輯電路的競爭冒險和時序邏輯電路的時序、時延等至關(guān)重要。

1.4 器件編程

當(dāng)電路設(shè)計、校驗之后,Max+plus Ⅱ的Programmer 將編譯器所生成的編譯文件下載到具體的CPLD器件中,即實現(xiàn)目標(biāo)器件的物理編程[5]。

2 以計數(shù)器為例介紹具體的設(shè)計方法

計數(shù)器是非常常用的時序邏輯電路。計數(shù)器類型有多種,實現(xiàn)計數(shù)器的方法也有很多。可以買到大部分類型的中規(guī)模集成的計數(shù)器直接使用,也可以用觸發(fā)器搭建符合要求的計數(shù)器。但是采用以上方法實現(xiàn)的計數(shù)器靈活性不夠,不能隨時進(jìn)行修改,通用性差。這里介紹基于可編程邏輯器件的實現(xiàn)方法。

2.1 設(shè)計輸入

采用原理圖輸入的思維方式比較適合一直采用傳統(tǒng)設(shè)計方法人的使用。原理圖輸入如圖1所示。

圖1 原理輸入圖

采用硬件描述語言輸入的方法對于沒有傳統(tǒng)設(shè)計方法經(jīng)驗的人更容易入門,修改起來也更方便。給出了一個可逆計數(shù)器的實現(xiàn)實例[6],程序的核心部分如下[7]:

PROCESS (clk)

VARIABLE cnt:INTEGER RANGE 0 TO 255;

VARIABLE direction:INTEGER;

BEGIN

IF(updown=′1′)THEN

direction:=1;

ELSE

direction:=-1;

END IF;

IF(clk′EVENT AND clk=′1′)THEN

cnt:=cnt+direction;

END IF;

qd <= cnt;

end process;

2.2 設(shè)計處理

原理圖或程序完成之后,選擇好器件并進(jìn)行引腳定義,然后編譯優(yōu)化得到編程文件的界面如圖2所示[8]。

2.3 設(shè)計檢查

編譯結(jié)束后,建立波形文件進(jìn)行仿真,注意波形文件需要先保存,保存文件名和源文件一致才能進(jìn)行仿真[9]。結(jié)果如圖3所示。

圖2 編譯優(yōu)化得到編程文件的界面

圖3 仿真結(jié)果

仿真結(jié)果達(dá)到設(shè)計目的,符合設(shè)計要求。這時可以把編譯生成的*.pof文件下載到選定的器件使用。用以上方法實現(xiàn)的器件,修改起來非常方便,只需要修改程序重新編譯下載即可,任何類型的計數(shù)器都可以在可編程邏輯器件實現(xiàn)。

3 結(jié) 語

隨著電子技術(shù)的高速發(fā)展,CPLD 和FPGA 器件在集成度、功能和性能(速度及可靠性)方面已經(jīng)能夠滿足大多數(shù)場合的使用要求。用CPLD,FPGA等大規(guī)模可編程邏輯器件取代傳統(tǒng)的標(biāo)準(zhǔn)集成電路、接口電路和專用集成電路已成為技術(shù)發(fā)展的必然趨勢。

可編程邏輯器件是邏輯器件家族中發(fā)展最快的一類器件,它出現(xiàn)使得產(chǎn)品開發(fā)周期縮短、現(xiàn)場靈活性好、開發(fā)風(fēng)險變小,隨著工藝、技術(shù)及市場的不斷發(fā)展,PLD產(chǎn)品的價格將越來越便宜、集成度越來越高、速度越來越快,再加上其設(shè)計開發(fā)采用符合國際標(biāo)準(zhǔn)的、功能強(qiáng)大的通用性EDA工具,可編程邏輯器件的應(yīng)用前景將愈來愈廣闊[10]。

參考文獻(xiàn)

[1]徐偉業(yè),江冰,虔湘賓.CPLD/FPGA的發(fā)展與應(yīng)用之比較[J].現(xiàn)代電子技術(shù),2007,30(2):4-7.

[2]鄭寶華.基于CPLD的大屏幕掃描電路設(shè)計[J].現(xiàn)代電子技術(shù),2008,31(24):17-19.

[3]趙延,葛利嘉,雙濤.基于FPGA的UART設(shè)計實現(xiàn)及其驗證方法[J].現(xiàn)代電子技術(shù),2008,31(17):162-164.

[4]王淑文.基于CPLD的數(shù)字系統(tǒng)設(shè)計[J].現(xiàn)代電子技術(shù),2007,30(12):184-186.

[5]楊暉,張鳳言.大規(guī)模可編程邏輯器件與數(shù)字系統(tǒng)設(shè)計[M].北京:北京航空航天大學(xué)出版社,2001.

[6]潘松.VHLD 實用教程[M].西安:西安電子科技大學(xué)出版社,2000.

[7]宋萬杰.CPLD技術(shù)及其應(yīng)用[M].西安:西安電子科技大學(xué)出版社,2000.

[8]林明權(quán).VHDL數(shù)字控制系統(tǒng)設(shè)計范例[M].北京:電子工業(yè)出版社,2003.

[9]曾繁泰,陳美金.VHDL程序設(shè)計[M].北京:清華大學(xué)出版社,2000.

[10]田開坤,徐海霞.基于CPLD的單片機(jī)接口設(shè)計[J].現(xiàn)代電子技術(shù),2008,31(2):34-36.

主站蜘蛛池模板: 国产日产欧美精品| 色成人亚洲| 国产人成午夜免费看| 国产午夜一级淫片| 青草视频在线观看国产| 国产日韩精品欧美一区喷| 日韩精品资源| 亚洲Aⅴ无码专区在线观看q| 欧美激情,国产精品| 国产新AV天堂| 亚洲欧美精品在线| 久久www视频| 久夜色精品国产噜噜| 亚洲日本一本dvd高清| 免费国产高清视频| 五月婷婷亚洲综合| 最新亚洲人成无码网站欣赏网| www中文字幕在线观看| 国产日本欧美亚洲精品视| 亚洲丝袜第一页| 青青草91视频| 在线观看亚洲国产| 91福利片| 国产福利免费在线观看| 国产午夜看片| 99久久国产综合精品2023| 在线国产毛片| 日韩精品亚洲一区中文字幕| 国产亚洲成AⅤ人片在线观看| 成人免费一区二区三区| 国产一区二区丝袜高跟鞋| а∨天堂一区中文字幕| 久久综合九九亚洲一区| 成人精品区| 久久精品一品道久久精品| 一本久道久综合久久鬼色| 香蕉久久永久视频| 亚洲第一视频免费在线| 一级毛片免费观看久| 欧美日本一区二区三区免费| 日本在线国产| 国产va免费精品观看| 思思热在线视频精品| 久久99国产乱子伦精品免| 成人免费视频一区| 欧美视频免费一区二区三区| 亚洲国产成人精品青青草原| 精品人妻系列无码专区久久| 国产亚卅精品无码| 日本午夜精品一本在线观看| 国产精品人成在线播放| 国产屁屁影院| 91福利免费视频| 福利在线免费视频| 欧美黄网在线| 一级毛片无毒不卡直接观看| 国产精品一区二区久久精品无码| 国产特级毛片| 国产高清精品在线91| 自拍偷拍欧美日韩| 一级爆乳无码av| 国产精品不卡片视频免费观看| 国产精品欧美激情| 亚洲天堂色色人体| 亚洲床戏一区| 在线免费亚洲无码视频| 亚洲成aⅴ人片在线影院八| 99视频在线观看免费| 国产不卡国语在线| 国产网站黄| 免费欧美一级| 国产亚洲精品97在线观看| 成人午夜在线播放| 国产色婷婷视频在线观看| 区国产精品搜索视频| 伊人婷婷色香五月综合缴缴情| 久热中文字幕在线观看| 国产毛片久久国产| 她的性爱视频| 免费国产不卡午夜福在线观看| 中文字幕日韩欧美| 香蕉eeww99国产在线观看|