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智能優化算法在集成電路設計中的應用研究
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隨著科技的進步,集成電路設計的復雜性與難度越來越高,傳統的算法已經不能滿足人們對集成電路的功能需求。同時傳統的算法一般為人工設計,需要的時間與成本相對較高。所以如何設計一種智能的算法對集成電路進行設計對我國集成電路的發展是十分重要的。智能優化算法可以很好地解決上述的問題。智能優化算法是以自然界生物群體所表現的智能現象為基礎進行設計,可以自我進化,免疫,和自我適應。所以文章主要對智能優化算法在集成電路設計中的應用進行相應的研究。
集成電路;優化算法;應用
對于系統復雜性的設計,通過對設計過程的加速,來進行相應計算機的輔助綜合性分析,包括對電路進行模擬﹑射頻等辦法。數字電路能夠更加簡單的將不同邏輯層次進行抽離,提高電路的自動分布。模擬電路設計過程,因為種類繁多,結構差異巨大,設計需要大量的人力物力和技術指導。有效地將智能算法在各種大范圍的電路設計中進行應用,可以更好地增加電路設計效率,解決集成電路中存在的多沖突指標。還能夠發揮出自身潛在特點,提供設計者相應的數據庫進行電路方面的設計工作。
集成電路在人們生活中的應用是十分廣泛的。只有大力發展智能優化算法才能幫助我們更好地進行繼集成電路的設計。人們利用自然界來認識更多的事物,并且通過事物的來源進行想象與創造。智能優化算法就是基于自然界,進行適應性啟發,從而模擬進化出來的計算機的表達方式。智能優化算法可以起到自我適應,自我改進等優點。可以進行全面的全局搜索。如果選擇到位最優解則選擇這種方式作為問題的解法,如果選擇的不是最優解那么就會再次進行路徑的選擇,不斷循環直到達到想要的結果。
2.1 禁忌搜索算法
禁忌搜索(TabuSearch,TS)算法是一種模仿人類大腦記憶功能的元啟發式算法,最早是由FredGlover提出,它比局部搜索領域范圍更廣,具有一定的全局搜索能力。禁忌算法通過Tabu表鎖住剛搜索過的區域,并通過禁忌準則防止算法進行反復搜索,同時通過藐視準則將禁忌表中的一些優良個體解禁出來,這樣算法搜索過程具有多樣性,才能避免算法陷入局部最優,最終搜索到全局最優解。目前,TS算法主要用于NP問題﹑生產調度﹑組合優化﹑神經網絡和電路設計等領域,近年來在函數的全局優化方面也有很多的研究,隨著算法的發展和改進,它的應用范圍還會不斷擴大。
2.2 模擬退火算法
模擬退火算法(Simulated Annealing,SA)是由 Metropolis 等于1953 年提出的重要性采樣法,即以概率接受新狀態,稱 Metropolis準則,計算量相對 Monte-Carlo 方法顯著減少,但未引起反響。1982年 Kirkpatrick 等將其應用于組合優化問題的求解,才得到廣泛的應用。SA 的基本思想主要是模擬熱力學中的退火過程,它主要來源于固體物質的退火過程,將固體加溫到足夠高的溫度,再將其慢慢冷卻,加溫時固體內部粒子呈無序狀(最高的熵值),內能增大,而慢慢冷卻時粒子漸趨有序(熵值下降),在每個溫度都能達到平衡狀態,最后在常溫時達到基態,內能減為最小(最低的熵值),其過程與一般組合優化問題很相似。在概率理論上模擬退火算法可用馬爾可夫(Markov)過程的數學模型來解釋。
2.3 群智能優化算法
群智能優化算法是近幾十年才發展起來的一種新興的演化優化算法,也是受到最多關注的優化研究領域之一。信息的交互過程中不但整個群體內傳播信息,群體內的個體也能處理信息,并通過所得到的信息(包括環境信息和其它個體信息等)去改變自身的行為規范,這樣整個群體就擁有了一些個體所不具備的特征和能力,特別是對周圍環境的適應能力,這種對周圍環境改變所具備的適應能力其實就是所說的“智能”。受這些生物群體的集體行為的啟示,人們摸索出了一種新的優化技術——群智能優化算法。
2.4 遺傳算法
遺傳算法是模擬達爾文的生物進化論的自然選擇和遺傳學機理的生物進化過程的計算模模型,是一種通過模擬自然進化過程搜索最優解的方法。遺傳算法從問題解的串集開始搜索,而不是從單個解開始。遺傳算法中需要很多的函數,在具體應用中,適應度函數的設計要結合求解問題本身的要求而定。適應度函數設計直接影響到遺傳算法的性能。
1)在射頻集成電路中的應用
傳統的射頻(Radio Frequency,RF)集成電路設計方法是設計者基于專業知識和設計經驗,通過反復多次的模擬試驗對電路性能進行優化的。這種設計方法不但需要很長的設計時間,而且還很難達到多項性能的最優化。隨著現代優化算法的發展,人們可以通過計算機進行電路自動優化。這種優化技術最初應用于模擬集成電路的尺寸最優化,設計者可以通過某一優化算法進行電路尺寸自動搜索,直至電路性能達到設計要求。射頻集成電路的設計也從中受到了啟發,相關優化設計研究方法也逐漸開展起來。
2)遺傳算法在數字集成電路中的應用
對于數字集成電路,可以很容易抽象出邏輯門﹑加法器﹑減法器﹑寄存器等不同層次的邏輯單元,這種抽象大大促進了數字集成電路的設計自動化。從高層次的自動綜合,到最低層次的集成電路版圖的布局布線,都有較為成熟和實用的自動設計軟件工具。采用遺傳算法對具有代表性的全加器進行自動優化設計。所選用的電路拓撲結構圖是將全加器中的每個邏輯門看作一個小單元,對于三輸入兩輸出的全加器看成一個3*3的二維單元數組。
文章主要分析了幾種重要的智能優化算法,并對其進行了相應的解釋。雖然這些算法已經可以很好地幫助我們進行集成電路的設計,但是這樣還是遠遠不夠的,還要進行更多的研究,研發更有用處,更完善的算法應用到集成電路的設計中去。
[1]杜奇功,張彪,虎帥,劉海軍.智能優化算法在集成電路設計中的應用研究[J].科技創新與應用,2016,21:98.
[2]王愷爾.基于智能優化算法的半導體器件參數提取方法研究[D].浙江師范大學,2009.